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摘要
本发明公开了一种基于FPGA的低轨卫星通信网络仿真系统,包括：HBM、HBM控制模块、TST模块、配置接口。其中,HBM控制模块根据接收到的用户号查询该用户的延迟时间,基于延迟时间计算该用户号对应的用户数据的发送时间,向高带宽存储器HBM写入用户数据及其对应的发送时间。TST模块将接收到的用户数据进行时隙交换。本发明利用HBM的大内存与高速的读写,支持大规模节点和高数据速率仿真；且通过HBM控制模块,基于配置的延迟时间对用户数据进行延迟转发来模拟卫星网络的传输延迟,通过TST模块控制用户数据的时隙交换关系来模拟低轨卫星通信网络的链路通断情况,在能够实现真实的并行通信情况下,得到较高质量的仿真结果。
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