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摘要
本发明属于通信数据存储技术领域,公开了一种分支流水线结构的ECC译码方法及系统,主要包括BCH译码器、数据输出、分支流水线控制和RAM存储阵列四个模块。根据16位并行输入数据计算伴随式,判断输入数据是否出错,形成两个数据流水分支：当数据无错时,跳过BCH译码器的后续模块,直接读取RAM存储阵列进行数据输出；当数据出错时,在经过错误位置多项式求解模块和错误定位器模块确定出错误图样后,根据16位宽的错误图样,进行数据纠错输出,不同数据单元之间构成两级分支流水。本发明采用16位并行、两级分支流水结构,极大地提高了数据总线传输速率,加快整体译码速度,节约时钟周期。
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