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摘要
基于扩展汉明码和现有的TPC编译码算法,提出了一种截短型TPC编译码器的FPGA实现方法。介绍了其编码的构造方法,并针对其构造方法提出了具体的FPGA实现结构。分析了基于软输入软输出的ChaseⅡ迭代译码算法,阐述了Chase算法各个模块部分的FPGA具体实现结构,采用译码数据多路并行处理方法,实现了较高速率的TPC译码。最后给出了该编译码器的FPGA实现结果,对编码环进行了测试并给出了误码率。
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基于扩展汉明码和现有的TPC编译码算法,提出了一种截短型TPC编译码器的FPGA实现方法。介绍了其编码的构造方法,并针对其构造方法提出了具体的FPGA实现结构。分析了基于软输入软输出的ChaseⅡ迭代译码算法,阐述了Chase算法各个模块部分的FPGA具体实现结构,采用译码数据多路并行处理方法,实现了较高速率的TPC译码。最后给出了该编译码器的FPGA实现结果,对编码环进行了测试并给出了误码率。
