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摘要
本发明公开了一种用于优化快速傅里叶变换的存内计算加速电路及方法,属于数字信号处理技术领域。其中电路包括：总线接口转换模块,用于接收数据流,将数据流转换为数据流控制时序信号；存储模块,用于存储原始输入数据和经过存内计算阵列计算完毕所产生的数据；存内计算阵列,用于接收来自存储模块的数据进行傅里叶变换运算,并将运算结果返回存储模块；行复制控制模块,用于生成被复制数据的源行地址以及将被放置的目的地址,控制每一级的计算,并将每一级的计算结果复制到下一轮计算所需的存储阵列位置；以及生成原始输入数据在存算模块中的初始地址。本发明有效地解决了传统快速傅里叶变换电路设计中高功耗,高延迟的技术问题。
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