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摘要
本文基于对纹理贴图三种常用算法的分析,完成了可重构纹理贴图加速器的设计和加速器电路的外部接口设计,作为可重构图形处理器的重要组成部分,完善了原型系统设计。采用软硬件协同的验证方法在原型系统验证平台上给出了纹理贴图加速器的FPGA验证方案,在Virtex6系列芯片XC6VLX550T开发板上进行了基于FPGA的功能验证与性能分析比较。本文所设计的纹理贴图加速器可以根据场景和性能的差异决定选择不同纹理贴图算法,灵活性更高,同时提高了像素处理的并行性,像素填充率成倍提高,兼顾图形处理器的高性能。
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单位西安邮电大学; 电子工程学院
