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摘要
IEEE1588V2提出的时钟同步方法在电信、电力系统、网络通信中有重要应用,在时间同步精度已经达到微秒级别时,PHY中FIFO内数据的抖动将成为影响1588精度的主要因素之一;文章介绍了PHY影响1588时钟精度的原理,讨论了PHY中的时延抖动机制,为了减小PHY对1588同步过程中的链路延时的影响,提出提高本地晶振精度、透明时钟与主时钟采用同一频率源,最后采用时间序列法对链路延时值进行建模处理得到最可几的值,实验结果表明采用文中方法能将链路延时的误差减小到50ns内,较好地提高了1588同步精度。
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